| FPGA與DSP聯(lián)合應(yīng)用 |
班級(jí)規(guī)模及環(huán)境--熱線:4008699035 手機(jī):15921673576( 微信同號(hào)) |
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每期人數(shù)限3到5人。 |
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時(shí)間地點(diǎn) |
上課地點(diǎn)：【上海】：同濟(jì)大學(xué)(滬西)/新城金郡商務(wù)樓(11號(hào)線白銀路站) 【深圳分部】：電影大廈(地鐵一號(hào)線大劇院站)/深圳大學(xué)成教院 【北京分部】：北京中山學(xué)院/福鑫大樓 【南京分部】：金港大廈(和燕路) 【武漢分部】：佳源大廈（高新二路） 【成都分部】：領(lǐng)館區(qū)1號(hào)（中和大道） 【沈陽分部】：沈陽理工大學(xué)/六宅臻品 【鄭州分部】：鄭州大學(xué)/錦華大廈 【石家莊分部】：河北科技大學(xué)/瑞景大廈 【廣州分部】：廣糧大廈 【西安分部】：協(xié)同大廈
最近開課時(shí)間(周末班/連續(xù)班/晚班）：FPGA和DSP聯(lián)合班：2020年3月16日 |
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學(xué)時(shí)和費(fèi)用 |
★課時(shí)：
請(qǐng)咨詢?cè)诰�客服
☆注重質(zhì)量
☆邊講邊練
☆合格學(xué)員免費(fèi)推薦工作
☆合格學(xué)員免費(fèi)頒發(fā)相關(guān)工程師等資格證書，提升您的職業(yè)資質(zhì)
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得到大家的認(rèn)同，受到用人單位的廣泛贊譽(yù)。
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最新優(yōu)惠 |
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質(zhì)量保障 |
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1、培訓(xùn)過程中，如有部分內(nèi)容理解不透或消化不好，可免費(fèi)在以后培訓(xùn)班中重聽；
2、培訓(xùn)結(jié)束后,授課老師留給學(xué)員聯(lián)系方式,保障培訓(xùn)效果,免費(fèi)提供課后技術(shù)支持。
3、培訓(xùn)合格學(xué)員可享受免費(fèi)推薦就業(yè)機(jī)會(huì)。 |
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課程大綱: |
FPGA與DSP聯(lián)合應(yīng)用 |
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| FPGA與DSP聯(lián)合應(yīng)用 |
| 課程簡(jiǎn)介： |
DSP應(yīng)用是展示FPGA優(yōu)勢(shì)的最有效場(chǎng)合。通過本次課的學(xué)習(xí)，可以幫助學(xué)員掌握使用FPGA實(shí)現(xiàn)DSP的基本理論和實(shí)現(xiàn)方法。掌握針對(duì)DSP的Verilog編程方法，實(shí)現(xiàn)如Cordic算法、FFT
IP Core使用等經(jīng)典內(nèi)容。 |
| 培訓(xùn)時(shí)長(zhǎng)： |
四天 |
| 必備條件： |
熟練掌握Verilog HDL |
| 獲得技能： |
掌握使用FPGA實(shí)現(xiàn)DSP的基本理論和實(shí)現(xiàn)方法。 |
| 課程大綱： |
第一階段 |
| Verilog for DSP |
| 第二階段 |
| Cordic算法實(shí)現(xiàn) |
| 第三階段 |
| 浮點(diǎn)算法的定點(diǎn)處理 |
| 第四階段 |
| 浮點(diǎn)數(shù)與定點(diǎn)數(shù) |
| 第五階段 |
| 浮點(diǎn)如何轉(zhuǎn)定點(diǎn) |
| 第六階段 |
| FPGA實(shí)現(xiàn)DSP的優(yōu)勢(shì)及應(yīng)用的典型場(chǎng)合 |
| 第七階段 |
| 多速率信號(hào)處理(中頻數(shù)字化的理論) |
| 第八階段 |
| 帶通采樣定理 |
| 第九階段 |
| 內(nèi)插與抽取 |
| 第十階段 |
| FFT IP Core的使用方法 |
| 第十一階段 |
| FPGA+DSP架構(gòu)分析 |
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